1
2
3
4#ifndef __RTL92DE_TRX_H__
5#define __RTL92DE_TRX_H__
6
7#define TX_DESC_SIZE 64
8#define TX_DESC_AGGR_SUBFRAME_SIZE 32
9
10#define RX_DESC_SIZE 32
11#define RX_DRV_INFO_SIZE_UNIT 8
12
13#define TX_DESC_NEXT_DESC_OFFSET 40
14#define USB_HWDESC_HEADER_LEN 32
15#define CRCLENGTH 4
16
17
18
19
20
21
22#define SHIFT_AND_MASK_LE(__pdesc, __shift, __mask) \
23 ((le32_to_cpu(*(((__le32 *)(__pdesc)))) >> (__shift)) & \
24 BIT_LEN_MASK_32(__mask))
25
26
27
28
29
30
31
32
33#define SET_BITS_OFFSET_LE(__pdesc, __shift, __len, __val) \
34 (*(__le32 *)(__pdesc) = \
35 (cpu_to_le32((le32_to_cpu(*((__le32 *)(__pdesc))) & \
36 (~(BIT_OFFSET_LEN_MASK_32((__shift), __len)))) | \
37 (((u32)(__val) & BIT_LEN_MASK_32(__len)) << (__shift)))));
38
39
40
41#define SET_TX_DESC_PKT_SIZE(__pdesc, __val) \
42 SET_BITS_OFFSET_LE(__pdesc, 0, 16, __val)
43#define SET_TX_DESC_OFFSET(__pdesc, __val) \
44 SET_BITS_OFFSET_LE(__pdesc, 16, 8, __val)
45#define SET_TX_DESC_BMC(__pdesc, __val) \
46 SET_BITS_OFFSET_LE(__pdesc, 24, 1, __val)
47#define SET_TX_DESC_HTC(__pdesc, __val) \
48 SET_BITS_OFFSET_LE(__pdesc, 25, 1, __val)
49#define SET_TX_DESC_LAST_SEG(__pdesc, __val) \
50 SET_BITS_OFFSET_LE(__pdesc, 26, 1, __val)
51#define SET_TX_DESC_FIRST_SEG(__pdesc, __val) \
52 SET_BITS_OFFSET_LE(__pdesc, 27, 1, __val)
53#define SET_TX_DESC_LINIP(__pdesc, __val) \
54 SET_BITS_OFFSET_LE(__pdesc, 28, 1, __val)
55#define SET_TX_DESC_NO_ACM(__pdesc, __val) \
56 SET_BITS_OFFSET_LE(__pdesc, 29, 1, __val)
57#define SET_TX_DESC_GF(__pdesc, __val) \
58 SET_BITS_OFFSET_LE(__pdesc, 30, 1, __val)
59#define SET_TX_DESC_OWN(__pdesc, __val) \
60 SET_BITS_OFFSET_LE(__pdesc, 31, 1, __val)
61
62#define GET_TX_DESC_PKT_SIZE(__pdesc) \
63 SHIFT_AND_MASK_LE(__pdesc, 0, 16)
64#define GET_TX_DESC_OFFSET(__pdesc) \
65 SHIFT_AND_MASK_LE(__pdesc, 16, 8)
66#define GET_TX_DESC_BMC(__pdesc) \
67 SHIFT_AND_MASK_LE(__pdesc, 24, 1)
68#define GET_TX_DESC_HTC(__pdesc) \
69 SHIFT_AND_MASK_LE(__pdesc, 25, 1)
70#define GET_TX_DESC_LAST_SEG(__pdesc) \
71 SHIFT_AND_MASK_LE(__pdesc, 26, 1)
72#define GET_TX_DESC_FIRST_SEG(__pdesc) \
73 SHIFT_AND_MASK_LE(__pdesc, 27, 1)
74#define GET_TX_DESC_LINIP(__pdesc) \
75 SHIFT_AND_MASK_LE(__pdesc, 28, 1)
76#define GET_TX_DESC_NO_ACM(__pdesc) \
77 SHIFT_AND_MASK_LE(__pdesc, 29, 1)
78#define GET_TX_DESC_GF(__pdesc) \
79 SHIFT_AND_MASK_LE(__pdesc, 30, 1)
80#define GET_TX_DESC_OWN(__pdesc) \
81 SHIFT_AND_MASK_LE(__pdesc, 31, 1)
82
83#define SET_TX_DESC_MACID(__pdesc, __val) \
84 SET_BITS_OFFSET_LE(__pdesc+4, 0, 5, __val)
85#define SET_TX_DESC_AGG_ENABLE(__pdesc, __val) \
86 SET_BITS_OFFSET_LE(__pdesc+4, 5, 1, __val)
87#define SET_TX_DESC_BK(__pdesc, __val) \
88 SET_BITS_OFFSET_LE(__pdesc+4, 6, 1, __val)
89#define SET_TX_DESC_RDG_ENABLE(__pdesc, __val) \
90 SET_BITS_OFFSET_LE(__pdesc+4, 7, 1, __val)
91#define SET_TX_DESC_QUEUE_SEL(__pdesc, __val) \
92 SET_BITS_OFFSET_LE(__pdesc+4, 8, 5, __val)
93#define SET_TX_DESC_RDG_NAV_EXT(__pdesc, __val) \
94 SET_BITS_OFFSET_LE(__pdesc+4, 13, 1, __val)
95#define SET_TX_DESC_LSIG_TXOP_EN(__pdesc, __val) \
96 SET_BITS_OFFSET_LE(__pdesc+4, 14, 1, __val)
97#define SET_TX_DESC_PIFS(__pdesc, __val) \
98 SET_BITS_OFFSET_LE(__pdesc+4, 15, 1, __val)
99#define SET_TX_DESC_RATE_ID(__pdesc, __val) \
100 SET_BITS_OFFSET_LE(__pdesc+4, 16, 4, __val)
101#define SET_TX_DESC_NAV_USE_HDR(__pdesc, __val) \
102 SET_BITS_OFFSET_LE(__pdesc+4, 20, 1, __val)
103#define SET_TX_DESC_EN_DESC_ID(__pdesc, __val) \
104 SET_BITS_OFFSET_LE(__pdesc+4, 21, 1, __val)
105#define SET_TX_DESC_SEC_TYPE(__pdesc, __val) \
106 SET_BITS_OFFSET_LE(__pdesc+4, 22, 2, __val)
107#define SET_TX_DESC_PKT_OFFSET(__pdesc, __val) \
108 SET_BITS_OFFSET_LE(__pdesc+4, 26, 8, __val)
109
110#define GET_TX_DESC_MACID(__pdesc) \
111 SHIFT_AND_MASK_LE(__pdesc+4, 0, 5)
112#define GET_TX_DESC_AGG_ENABLE(__pdesc) \
113 SHIFT_AND_MASK_LE(__pdesc+4, 5, 1)
114#define GET_TX_DESC_AGG_BREAK(__pdesc) \
115 SHIFT_AND_MASK_LE(__pdesc+4, 6, 1)
116#define GET_TX_DESC_RDG_ENABLE(__pdesc) \
117 SHIFT_AND_MASK_LE(__pdesc+4, 7, 1)
118#define GET_TX_DESC_QUEUE_SEL(__pdesc) \
119 SHIFT_AND_MASK_LE(__pdesc+4, 8, 5)
120#define GET_TX_DESC_RDG_NAV_EXT(__pdesc) \
121 SHIFT_AND_MASK_LE(__pdesc+4, 13, 1)
122#define GET_TX_DESC_LSIG_TXOP_EN(__pdesc) \
123 SHIFT_AND_MASK_LE(__pdesc+4, 14, 1)
124#define GET_TX_DESC_PIFS(__pdesc) \
125 SHIFT_AND_MASK_LE(__pdesc+4, 15, 1)
126#define GET_TX_DESC_RATE_ID(__pdesc) \
127 SHIFT_AND_MASK_LE(__pdesc+4, 16, 4)
128#define GET_TX_DESC_NAV_USE_HDR(__pdesc) \
129 SHIFT_AND_MASK_LE(__pdesc+4, 20, 1)
130#define GET_TX_DESC_EN_DESC_ID(__pdesc) \
131 SHIFT_AND_MASK_LE(__pdesc+4, 21, 1)
132#define GET_TX_DESC_SEC_TYPE(__pdesc) \
133 SHIFT_AND_MASK_LE(__pdesc+4, 22, 2)
134#define GET_TX_DESC_PKT_OFFSET(__pdesc) \
135 SHIFT_AND_MASK_LE(__pdesc+4, 24, 8)
136
137#define SET_TX_DESC_RTS_RC(__pdesc, __val) \
138 SET_BITS_OFFSET_LE(__pdesc+8, 0, 6, __val)
139#define SET_TX_DESC_DATA_RC(__pdesc, __val) \
140 SET_BITS_OFFSET_LE(__pdesc+8, 6, 6, __val)
141#define SET_TX_DESC_BAR_RTY_TH(__pdesc, __val) \
142 SET_BITS_OFFSET_LE(__pdesc+8, 14, 2, __val)
143#define SET_TX_DESC_MORE_FRAG(__pdesc, __val) \
144 SET_BITS_OFFSET_LE(__pdesc+8, 17, 1, __val)
145#define SET_TX_DESC_RAW(__pdesc, __val) \
146 SET_BITS_OFFSET_LE(__pdesc+8, 18, 1, __val)
147#define SET_TX_DESC_CCX(__pdesc, __val) \
148 SET_BITS_OFFSET_LE(__pdesc+8, 19, 1, __val)
149#define SET_TX_DESC_AMPDU_DENSITY(__pdesc, __val) \
150 SET_BITS_OFFSET_LE(__pdesc+8, 20, 3, __val)
151#define SET_TX_DESC_ANTSEL_A(__pdesc, __val) \
152 SET_BITS_OFFSET_LE(__pdesc+8, 24, 1, __val)
153#define SET_TX_DESC_ANTSEL_B(__pdesc, __val) \
154 SET_BITS_OFFSET_LE(__pdesc+8, 25, 1, __val)
155#define SET_TX_DESC_TX_ANT_CCK(__pdesc, __val) \
156 SET_BITS_OFFSET_LE(__pdesc+8, 26, 2, __val)
157#define SET_TX_DESC_TX_ANTL(__pdesc, __val) \
158 SET_BITS_OFFSET_LE(__pdesc+8, 28, 2, __val)
159#define SET_TX_DESC_TX_ANT_HT(__pdesc, __val) \
160 SET_BITS_OFFSET_LE(__pdesc+8, 30, 2, __val)
161
162#define GET_TX_DESC_RTS_RC(__pdesc) \
163 SHIFT_AND_MASK_LE(__pdesc+8, 0, 6)
164#define GET_TX_DESC_DATA_RC(__pdesc) \
165 SHIFT_AND_MASK_LE(__pdesc+8, 6, 6)
166#define GET_TX_DESC_BAR_RTY_TH(__pdesc) \
167 SHIFT_AND_MASK_LE(__pdesc+8, 14, 2)
168#define GET_TX_DESC_MORE_FRAG(__pdesc) \
169 SHIFT_AND_MASK_LE(__pdesc+8, 17, 1)
170#define GET_TX_DESC_RAW(__pdesc) \
171 SHIFT_AND_MASK_LE(__pdesc+8, 18, 1)
172#define GET_TX_DESC_CCX(__pdesc) \
173 SHIFT_AND_MASK_LE(__pdesc+8, 19, 1)
174#define GET_TX_DESC_AMPDU_DENSITY(__pdesc) \
175 SHIFT_AND_MASK_LE(__pdesc+8, 20, 3)
176#define GET_TX_DESC_ANTSEL_A(__pdesc) \
177 SHIFT_AND_MASK_LE(__pdesc+8, 24, 1)
178#define GET_TX_DESC_ANTSEL_B(__pdesc) \
179 SHIFT_AND_MASK_LE(__pdesc+8, 25, 1)
180#define GET_TX_DESC_TX_ANT_CCK(__pdesc) \
181 SHIFT_AND_MASK_LE(__pdesc+8, 26, 2)
182#define GET_TX_DESC_TX_ANTL(__pdesc) \
183 SHIFT_AND_MASK_LE(__pdesc+8, 28, 2)
184#define GET_TX_DESC_TX_ANT_HT(__pdesc) \
185 SHIFT_AND_MASK_LE(__pdesc+8, 30, 2)
186
187#define SET_TX_DESC_NEXT_HEAP_PAGE(__pdesc, __val) \
188 SET_BITS_OFFSET_LE(__pdesc+12, 0, 8, __val)
189#define SET_TX_DESC_TAIL_PAGE(__pdesc, __val) \
190 SET_BITS_OFFSET_LE(__pdesc+12, 8, 8, __val)
191#define SET_TX_DESC_SEQ(__pdesc, __val) \
192 SET_BITS_OFFSET_LE(__pdesc+12, 16, 12, __val)
193#define SET_TX_DESC_PKT_ID(__pdesc, __val) \
194 SET_BITS_OFFSET_LE(__pdesc+12, 28, 4, __val)
195
196#define GET_TX_DESC_NEXT_HEAP_PAGE(__pdesc) \
197 SHIFT_AND_MASK_LE(__pdesc+12, 0, 8)
198#define GET_TX_DESC_TAIL_PAGE(__pdesc) \
199 SHIFT_AND_MASK_LE(__pdesc+12, 8, 8)
200#define GET_TX_DESC_SEQ(__pdesc) \
201 SHIFT_AND_MASK_LE(__pdesc+12, 16, 12)
202#define GET_TX_DESC_PKT_ID(__pdesc) \
203 SHIFT_AND_MASK_LE(__pdesc+12, 28, 4)
204
205#define SET_TX_DESC_RTS_RATE(__pdesc, __val) \
206 SET_BITS_OFFSET_LE(__pdesc+16, 0, 5, __val)
207#define SET_TX_DESC_AP_DCFE(__pdesc, __val) \
208 SET_BITS_OFFSET_LE(__pdesc+16, 5, 1, __val)
209#define SET_TX_DESC_QOS(__pdesc, __val) \
210 SET_BITS_OFFSET_LE(__pdesc+16, 6, 1, __val)
211#define SET_TX_DESC_HWSEQ_EN(__pdesc, __val) \
212 SET_BITS_OFFSET_LE(__pdesc+16, 7, 1, __val)
213#define SET_TX_DESC_USE_RATE(__pdesc, __val) \
214 SET_BITS_OFFSET_LE(__pdesc+16, 8, 1, __val)
215#define SET_TX_DESC_DISABLE_RTS_FB(__pdesc, __val) \
216 SET_BITS_OFFSET_LE(__pdesc+16, 9, 1, __val)
217#define SET_TX_DESC_DISABLE_FB(__pdesc, __val) \
218 SET_BITS_OFFSET_LE(__pdesc+16, 10, 1, __val)
219#define SET_TX_DESC_CTS2SELF(__pdesc, __val) \
220 SET_BITS_OFFSET_LE(__pdesc+16, 11, 1, __val)
221#define SET_TX_DESC_RTS_ENABLE(__pdesc, __val) \
222 SET_BITS_OFFSET_LE(__pdesc+16, 12, 1, __val)
223#define SET_TX_DESC_HW_RTS_ENABLE(__pdesc, __val) \
224 SET_BITS_OFFSET_LE(__pdesc+16, 13, 1, __val)
225#define SET_TX_DESC_PORT_ID(__pdesc, __val) \
226 SET_BITS_OFFSET_LE(__pdesc+16, 14, 1, __val)
227#define SET_TX_DESC_WAIT_DCTS(__pdesc, __val) \
228 SET_BITS_OFFSET_LE(__pdesc+16, 18, 1, __val)
229#define SET_TX_DESC_CTS2AP_EN(__pdesc, __val) \
230 SET_BITS_OFFSET_LE(__pdesc+16, 19, 1, __val)
231#define SET_TX_DESC_TX_SUB_CARRIER(__pdesc, __val) \
232 SET_BITS_OFFSET_LE(__pdesc+16, 20, 2, __val)
233#define SET_TX_DESC_TX_STBC(__pdesc, __val) \
234 SET_BITS_OFFSET_LE(__pdesc+16, 22, 2, __val)
235#define SET_TX_DESC_DATA_SHORT(__pdesc, __val) \
236 SET_BITS_OFFSET_LE(__pdesc+16, 24, 1, __val)
237#define SET_TX_DESC_DATA_BW(__pdesc, __val) \
238 SET_BITS_OFFSET_LE(__pdesc+16, 25, 1, __val)
239#define SET_TX_DESC_RTS_SHORT(__pdesc, __val) \
240 SET_BITS_OFFSET_LE(__pdesc+16, 26, 1, __val)
241#define SET_TX_DESC_RTS_BW(__pdesc, __val) \
242 SET_BITS_OFFSET_LE(__pdesc+16, 27, 1, __val)
243#define SET_TX_DESC_RTS_SC(__pdesc, __val) \
244 SET_BITS_OFFSET_LE(__pdesc+16, 28, 2, __val)
245#define SET_TX_DESC_RTS_STBC(__pdesc, __val) \
246 SET_BITS_OFFSET_LE(__pdesc+16, 30, 2, __val)
247
248#define GET_TX_DESC_RTS_RATE(__pdesc) \
249 SHIFT_AND_MASK_LE(__pdesc+16, 0, 5)
250#define GET_TX_DESC_AP_DCFE(__pdesc) \
251 SHIFT_AND_MASK_LE(__pdesc+16, 5, 1)
252#define GET_TX_DESC_QOS(__pdesc) \
253 SHIFT_AND_MASK_LE(__pdesc+16, 6, 1)
254#define GET_TX_DESC_HWSEQ_EN(__pdesc) \
255 SHIFT_AND_MASK_LE(__pdesc+16, 7, 1)
256#define GET_TX_DESC_USE_RATE(__pdesc) \
257 SHIFT_AND_MASK_LE(__pdesc+16, 8, 1)
258#define GET_TX_DESC_DISABLE_RTS_FB(__pdesc) \
259 SHIFT_AND_MASK_LE(__pdesc+16, 9, 1)
260#define GET_TX_DESC_DISABLE_FB(__pdesc) \
261 SHIFT_AND_MASK_LE(__pdesc+16, 10, 1)
262#define GET_TX_DESC_CTS2SELF(__pdesc) \
263 SHIFT_AND_MASK_LE(__pdesc+16, 11, 1)
264#define GET_TX_DESC_RTS_ENABLE(__pdesc) \
265 SHIFT_AND_MASK_LE(__pdesc+16, 12, 1)
266#define GET_TX_DESC_HW_RTS_ENABLE(__pdesc) \
267 SHIFT_AND_MASK_LE(__pdesc+16, 13, 1)
268#define GET_TX_DESC_PORT_ID(__pdesc) \
269 SHIFT_AND_MASK_LE(__pdesc+16, 14, 1)
270#define GET_TX_DESC_WAIT_DCTS(__pdesc) \
271 SHIFT_AND_MASK_LE(__pdesc+16, 18, 1)
272#define GET_TX_DESC_CTS2AP_EN(__pdesc) \
273 SHIFT_AND_MASK_LE(__pdesc+16, 19, 1)
274#define GET_TX_DESC_TX_SUB_CARRIER(__pdesc) \
275 SHIFT_AND_MASK_LE(__pdesc+16, 20, 2)
276#define GET_TX_DESC_TX_STBC(__pdesc) \
277 SHIFT_AND_MASK_LE(__pdesc+16, 22, 2)
278#define GET_TX_DESC_DATA_SHORT(__pdesc) \
279 SHIFT_AND_MASK_LE(__pdesc+16, 24, 1)
280#define GET_TX_DESC_DATA_BW(__pdesc) \
281 SHIFT_AND_MASK_LE(__pdesc+16, 25, 1)
282#define GET_TX_DESC_RTS_SHORT(__pdesc) \
283 SHIFT_AND_MASK_LE(__pdesc+16, 26, 1)
284#define GET_TX_DESC_RTS_BW(__pdesc) \
285 SHIFT_AND_MASK_LE(__pdesc+16, 27, 1)
286#define GET_TX_DESC_RTS_SC(__pdesc) \
287 SHIFT_AND_MASK_LE(__pdesc+16, 28, 2)
288#define GET_TX_DESC_RTS_STBC(__pdesc) \
289 SHIFT_AND_MASK_LE(__pdesc+16, 30, 2)
290
291#define SET_TX_DESC_TX_RATE(__pdesc, __val) \
292 SET_BITS_OFFSET_LE(__pdesc+20, 0, 6, __val)
293#define SET_TX_DESC_DATA_SHORTGI(__pdesc, __val) \
294 SET_BITS_OFFSET_LE(__pdesc+20, 6, 1, __val)
295#define SET_TX_DESC_CCX_TAG(__pdesc, __val) \
296 SET_BITS_OFFSET_LE(__pdesc+20, 7, 1, __val)
297#define SET_TX_DESC_DATA_RATE_FB_LIMIT(__pdesc, __val) \
298 SET_BITS_OFFSET_LE(__pdesc+20, 8, 5, __val)
299#define SET_TX_DESC_RTS_RATE_FB_LIMIT(__pdesc, __val) \
300 SET_BITS_OFFSET_LE(__pdesc+20, 13, 4, __val)
301#define SET_TX_DESC_RETRY_LIMIT_ENABLE(__pdesc, __val) \
302 SET_BITS_OFFSET_LE(__pdesc+20, 17, 1, __val)
303#define SET_TX_DESC_DATA_RETRY_LIMIT(__pdesc, __val) \
304 SET_BITS_OFFSET_LE(__pdesc+20, 18, 6, __val)
305#define SET_TX_DESC_USB_TXAGG_NUM(__pdesc, __val) \
306 SET_BITS_OFFSET_LE(__pdesc+20, 24, 8, __val)
307
308#define GET_TX_DESC_TX_RATE(__pdesc) \
309 SHIFT_AND_MASK_LE(__pdesc+20, 0, 6)
310#define GET_TX_DESC_DATA_SHORTGI(__pdesc) \
311 SHIFT_AND_MASK_LE(__pdesc+20, 6, 1)
312#define GET_TX_DESC_CCX_TAG(__pdesc) \
313 SHIFT_AND_MASK_LE(__pdesc+20, 7, 1)
314#define GET_TX_DESC_DATA_RATE_FB_LIMIT(__pdesc) \
315 SHIFT_AND_MASK_LE(__pdesc+20, 8, 5)
316#define GET_TX_DESC_RTS_RATE_FB_LIMIT(__pdesc) \
317 SHIFT_AND_MASK_LE(__pdesc+20, 13, 4)
318#define GET_TX_DESC_RETRY_LIMIT_ENABLE(__pdesc) \
319 SHIFT_AND_MASK_LE(__pdesc+20, 17, 1)
320#define GET_TX_DESC_DATA_RETRY_LIMIT(__pdesc) \
321 SHIFT_AND_MASK_LE(__pdesc+20, 18, 6)
322#define GET_TX_DESC_USB_TXAGG_NUM(__pdesc) \
323 SHIFT_AND_MASK_LE(__pdesc+20, 24, 8)
324
325#define SET_TX_DESC_TXAGC_A(__pdesc, __val) \
326 SET_BITS_OFFSET_LE(__pdesc+24, 0, 5, __val)
327#define SET_TX_DESC_TXAGC_B(__pdesc, __val) \
328 SET_BITS_OFFSET_LE(__pdesc+24, 5, 5, __val)
329#define SET_TX_DESC_USE_MAX_LEN(__pdesc, __val) \
330 SET_BITS_OFFSET_LE(__pdesc+24, 10, 1, __val)
331#define SET_TX_DESC_MAX_AGG_NUM(__pdesc, __val) \
332 SET_BITS_OFFSET_LE(__pdesc+24, 11, 5, __val)
333#define SET_TX_DESC_MCSG1_MAX_LEN(__pdesc, __val) \
334 SET_BITS_OFFSET_LE(__pdesc+24, 16, 4, __val)
335#define SET_TX_DESC_MCSG2_MAX_LEN(__pdesc, __val) \
336 SET_BITS_OFFSET_LE(__pdesc+24, 20, 4, __val)
337#define SET_TX_DESC_MCSG3_MAX_LEN(__pdesc, __val) \
338 SET_BITS_OFFSET_LE(__pdesc+24, 24, 4, __val)
339#define SET_TX_DESC_MCS7_SGI_MAX_LEN(__pdesc, __val) \
340 SET_BITS_OFFSET_LE(__pdesc+24, 28, 4, __val)
341
342#define GET_TX_DESC_TXAGC_A(__pdesc) \
343 SHIFT_AND_MASK_LE(__pdesc+24, 0, 5)
344#define GET_TX_DESC_TXAGC_B(__pdesc) \
345 SHIFT_AND_MASK_LE(__pdesc+24, 5, 5)
346#define GET_TX_DESC_USE_MAX_LEN(__pdesc) \
347 SHIFT_AND_MASK_LE(__pdesc+24, 10, 1)
348#define GET_TX_DESC_MAX_AGG_NUM(__pdesc) \
349 SHIFT_AND_MASK_LE(__pdesc+24, 11, 5)
350#define GET_TX_DESC_MCSG1_MAX_LEN(__pdesc) \
351 SHIFT_AND_MASK_LE(__pdesc+24, 16, 4)
352#define GET_TX_DESC_MCSG2_MAX_LEN(__pdesc) \
353 SHIFT_AND_MASK_LE(__pdesc+24, 20, 4)
354#define GET_TX_DESC_MCSG3_MAX_LEN(__pdesc) \
355 SHIFT_AND_MASK_LE(__pdesc+24, 24, 4)
356#define GET_TX_DESC_MCS7_SGI_MAX_LEN(__pdesc) \
357 SHIFT_AND_MASK_LE(__pdesc+24, 28, 4)
358
359#define SET_TX_DESC_TX_BUFFER_SIZE(__pdesc, __val) \
360 SET_BITS_OFFSET_LE(__pdesc+28, 0, 16, __val)
361#define SET_TX_DESC_MCSG4_MAX_LEN(__pdesc, __val) \
362 SET_BITS_OFFSET_LE(__pdesc+28, 16, 4, __val)
363#define SET_TX_DESC_MCSG5_MAX_LEN(__pdesc, __val) \
364 SET_BITS_OFFSET_LE(__pdesc+28, 20, 4, __val)
365#define SET_TX_DESC_MCSG6_MAX_LEN(__pdesc, __val) \
366 SET_BITS_OFFSET_LE(__pdesc+28, 24, 4, __val)
367#define SET_TX_DESC_MCS15_SGI_MAX_LEN(__pdesc, __val) \
368 SET_BITS_OFFSET_LE(__pdesc+28, 28, 4, __val)
369
370#define GET_TX_DESC_TX_BUFFER_SIZE(__pdesc) \
371 SHIFT_AND_MASK_LE(__pdesc+28, 0, 16)
372#define GET_TX_DESC_MCSG4_MAX_LEN(__pdesc) \
373 SHIFT_AND_MASK_LE(__pdesc+28, 16, 4)
374#define GET_TX_DESC_MCSG5_MAX_LEN(__pdesc) \
375 SHIFT_AND_MASK_LE(__pdesc+28, 20, 4)
376#define GET_TX_DESC_MCSG6_MAX_LEN(__pdesc) \
377 SHIFT_AND_MASK_LE(__pdesc+28, 24, 4)
378#define GET_TX_DESC_MCS15_SGI_MAX_LEN(__pdesc) \
379 SHIFT_AND_MASK_LE(__pdesc+28, 28, 4)
380
381#define SET_TX_DESC_TX_BUFFER_ADDRESS(__pdesc, __val) \
382 SET_BITS_OFFSET_LE(__pdesc+32, 0, 32, __val)
383#define SET_TX_DESC_TX_BUFFER_ADDRESS64(__pdesc, __val) \
384 SET_BITS_OFFSET_LE(__pdesc+36, 0, 32, __val)
385
386#define GET_TX_DESC_TX_BUFFER_ADDRESS(__pdesc) \
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388#define GET_TX_DESC_TX_BUFFER_ADDRESS64(__pdesc) \
389 SHIFT_AND_MASK_LE(__pdesc+36, 0, 32)
390
391#define SET_TX_DESC_NEXT_DESC_ADDRESS(__pdesc, __val) \
392 SET_BITS_OFFSET_LE(__pdesc+40, 0, 32, __val)
393#define SET_TX_DESC_NEXT_DESC_ADDRESS64(__pdesc, __val) \
394 SET_BITS_OFFSET_LE(__pdesc+44, 0, 32, __val)
395
396#define GET_TX_DESC_NEXT_DESC_ADDRESS(__pdesc) \
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399 SHIFT_AND_MASK_LE(__pdesc+44, 0, 32)
400
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427
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429 SET_BITS_OFFSET_LE(__pdesc, 0, 14, __val)
430#define SET_RX_DESC_EOR(__pdesc, __val) \
431 SET_BITS_OFFSET_LE(__pdesc, 30, 1, __val)
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433 SET_BITS_OFFSET_LE(__pdesc, 31, 1, __val)
434
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449#define GET_RX_DESC_PAM(__pdesc) \
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473
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490
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495
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499 SHIFT_AND_MASK_LE(__pdesc+28, 0, 32)
500
501#define SET_RX_DESC_BUFF_ADDR(__pdesc, __val) \
502 SET_BITS_OFFSET_LE(__pdesc+24, 0, 32, __val)
503#define SET_RX_DESC_BUFF_ADDR64(__pdesc, __val) \
504 SET_BITS_OFFSET_LE(__pdesc+28, 0, 32, __val)
505
506#define CLEAR_PCI_TX_DESC_CONTENT(__pdesc, _size) \
507 memset((void *)__pdesc, 0, \
508 min_t(size_t, _size, TX_DESC_NEXT_DESC_OFFSET))
509
510
511#define SET_EARLYMODE_PKTNUM(__paddr, __value) \
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520 SET_BITS_OFFSET_LE(__paddr+4, 0, 8, __value)
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522 SET_BITS_OFFSET_LE(__paddr+4, 8, 12, __value)
523#define SET_EARLYMODE_LEN4(__paddr, __value) \
524 SET_BITS_OFFSET_LE(__paddr+4, 20, 12, __value)
525
526struct rx_fwinfo_92d {
527 u8 gain_trsw[4];
528 u8 pwdb_all;
529 u8 cfosho[4];
530 u8 cfotail[4];
531 s8 rxevm[2];
532 s8 rxsnr[4];
533 u8 pdsnr[2];
534 u8 csi_current[2];
535 u8 csi_target[2];
536 u8 sigevm;
537 u8 max_ex_pwr;
538 u8 ex_intf_flag:1;
539 u8 sgi_en:1;
540 u8 rxsc:2;
541 u8 reserve:4;
542} __packed;
543
544struct tx_desc_92d {
545 u32 pktsize:16;
546 u32 offset:8;
547 u32 bmc:1;
548 u32 htc:1;
549 u32 lastseg:1;
550 u32 firstseg:1;
551 u32 linip:1;
552 u32 noacm:1;
553 u32 gf:1;
554 u32 own:1;
555
556 u32 macid:5;
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558 u32 bk:1;
559 u32 rdg_en:1;
560 u32 queuesel:5;
561 u32 rd_nav_ext:1;
562 u32 lsig_txop_en:1;
563 u32 pifs:1;
564 u32 rateid:4;
565 u32 nav_usehdr:1;
566 u32 en_descid:1;
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569
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577 u32 ccx:1;
578 u32 ampdudensity:3;
579 u32 rsvd2:1;
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587 u32 tailpage:8;
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604 u32 cts2ap_en:1;
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606 u32 stbc:2;
607 u32 txshort:1;
608 u32 txbw:1;
609 u32 rtsshort:1;
610 u32 rtsbw:1;
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612 u32 rtsstbc:2;
613
614 u32 txrate:6;
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616 u32 ccxt:1;
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618 u32 rtsrate_fb_lmt:4;
619 u32 retrylmt_en:1;
620 u32 txretrylmt:6;
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622
623 u32 txagca:5;
624 u32 txagcb:5;
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629 u32 mcsg3maxlen:4;
630 u32 mcs7sgimaxlen:4;
631
632 u32 txbuffersize:16;
633 u32 mcsg4maxlen:4;
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635 u32 mcsg6maxlen:4;
636 u32 mcsg15sgimaxlen:4;
637
638 u32 txbuffaddr;
639 u32 txbufferaddr64;
640 u32 nextdescaddress;
641 u32 nextdescaddress64;
642
643 u32 reserve_pass_pcie_mm_limit[4];
644} __packed;
645
646struct rx_desc_92d {
647 u32 length:14;
648 u32 crc32:1;
649 u32 icverror:1;
650 u32 drv_infosize:4;
651 u32 security:3;
652 u32 qos:1;
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681
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683 u32 rxht:1;
684 u32 amsdu:1;
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686 u32 bandwidth:1;
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689 u32 ipcchk_rpt:1;
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694
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698
699 u32 bufferaddress;
700 u32 bufferaddress64;
701
702} __packed;
703
704void rtl92de_tx_fill_desc(struct ieee80211_hw *hw,
705 struct ieee80211_hdr *hdr, u8 *pdesc,
706 u8 *pbd_desc_tx, struct ieee80211_tx_info *info,
707 struct ieee80211_sta *sta,
708 struct sk_buff *skb, u8 hw_queue,
709 struct rtl_tcb_desc *ptcb_desc);
710bool rtl92de_rx_query_desc(struct ieee80211_hw *hw,
711 struct rtl_stats *stats,
712 struct ieee80211_rx_status *rx_status,
713 u8 *pdesc, struct sk_buff *skb);
714void rtl92de_set_desc(struct ieee80211_hw *hw, u8 *pdesc, bool istx,
715 u8 desc_name, u8 *val);
716u64 rtl92de_get_desc(struct ieee80211_hw *hw,
717 u8 *p_desc, bool istx, u8 desc_name);
718void rtl92de_tx_polling(struct ieee80211_hw *hw, u8 hw_queue);
719void rtl92de_tx_fill_cmddesc(struct ieee80211_hw *hw, u8 *pdesc,
720 bool b_firstseg, bool b_lastseg,
721 struct sk_buff *skb);
722
723#endif
724
