1/* SPDX-License-Identifier: GPL-2.0-or-later */ 2/* 3 * Copyright 2004-2007 Freescale Semiconductor, Inc. All Rights Reserved. 4 * Copyright 2008 Juergen Beisert, kernel@pengutronix.de 5 * Copyright 2009 Holger Schurig, hs4233@mail.mn-solutions.de 6 * 7 * This contains i.MX21-specific hardware definitions. For those 8 * hardware pieces that are common between i.MX21 and i.MX27, have a 9 * look at mx2x.h. 10 */ 11 12#ifndef __MACH_MX21_H__ 13#define __MACH_MX21_H__ 14 15#define MX21_AIPI_BASE_ADDR 0x10000000 16#define MX21_AIPI_SIZE SZ_1M 17#define MX21_DMA_BASE_ADDR (MX21_AIPI_BASE_ADDR + 0x01000) 18#define MX21_WDOG_BASE_ADDR (MX21_AIPI_BASE_ADDR + 0x02000) 19#define MX21_GPT1_BASE_ADDR (MX21_AIPI_BASE_ADDR + 0x03000) 20#define MX21_GPT2_BASE_ADDR (MX21_AIPI_BASE_ADDR + 0x04000) 21#define MX21_GPT3_BASE_ADDR (MX21_AIPI_BASE_ADDR + 0x05000) 22#define MX21_PWM_BASE_ADDR (MX21_AIPI_BASE_ADDR + 0x06000) 23#define MX21_RTC_BASE_ADDR (MX21_AIPI_BASE_ADDR + 0x07000) 24#define MX21_KPP_BASE_ADDR (MX21_AIPI_BASE_ADDR + 0x08000) 25#define MX21_OWIRE_BASE_ADDR (MX21_AIPI_BASE_ADDR + 0x09000) 26#define MX21_UART1_BASE_ADDR (MX21_AIPI_BASE_ADDR + 0x0a000) 27#define MX21_UART2_BASE_ADDR (MX21_AIPI_BASE_ADDR + 0x0b000) 28#define MX21_UART3_BASE_ADDR (MX21_AIPI_BASE_ADDR + 0x0c000) 29#define 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0xcc000000 68#define MX21_CS2_BASE_ADDR 0xd0000000 69#define MX21_CS3_BASE_ADDR 0xd1000000 70#define MX21_CS4_BASE_ADDR 0xd2000000 71#define MX21_PCMCIA_MEM_BASE_ADDR 0xd4000000 72#define MX21_CS5_BASE_ADDR 0xdd000000 73 74/* NAND, SDRAM, WEIM etc controllers */ 75#define MX21_X_MEMC_BASE_ADDR 0xdf000000 76#define MX21_X_MEMC_SIZE SZ_256K 77 78#define MX21_SDRAMC_BASE_ADDR (MX21_X_MEMC_BASE_ADDR + 0x0000) 79#define MX21_EIM_BASE_ADDR (MX21_X_MEMC_BASE_ADDR + 0x1000) 80#define MX21_PCMCIA_CTL_BASE_ADDR (MX21_X_MEMC_BASE_ADDR + 0x2000) 81#define MX21_NFC_BASE_ADDR (MX21_X_MEMC_BASE_ADDR + 0x3000) 82 83#define MX21_IRAM_BASE_ADDR 0xffffe800 /* internal ram */ 84 85#define MX21_IO_P2V(x) IMX_IO_P2V(x) 86#define MX21_IO_ADDRESS(x) IOMEM(MX21_IO_P2V(x)) 87 88/* fixed interrupt numbers */ 89#include <asm/irq.h> 90#define MX21_INT_CSPI3 (NR_IRQS_LEGACY + 6) 91#define MX21_INT_GPIO (NR_IRQS_LEGACY + 8) 92#define MX21_INT_FIRI (NR_IRQS_LEGACY + 9) 93#define MX21_INT_SDHC2 (NR_IRQS_LEGACY + 10) 94#define MX21_INT_SDHC1 (NR_IRQS_LEGACY + 11) 95#define MX21_INT_I2C (NR_IRQS_LEGACY + 12) 96#define MX21_INT_SSI2 (NR_IRQS_LEGACY + 13) 97#define MX21_INT_SSI1 (NR_IRQS_LEGACY + 14) 98#define MX21_INT_CSPI2 (NR_IRQS_LEGACY + 15) 99#define MX21_INT_CSPI1 (NR_IRQS_LEGACY + 16) 100#define MX21_INT_UART4 (NR_IRQS_LEGACY + 17) 101#define MX21_INT_UART3 (NR_IRQS_LEGACY + 18) 102#define MX21_INT_UART2 (NR_IRQS_LEGACY + 19) 103#define MX21_INT_UART1 (NR_IRQS_LEGACY + 20) 104#define MX21_INT_KPP (NR_IRQS_LEGACY + 21) 105#define MX21_INT_RTC (NR_IRQS_LEGACY + 22) 106#define MX21_INT_PWM (NR_IRQS_LEGACY + 23) 107#define MX21_INT_GPT3 (NR_IRQS_LEGACY + 24) 108#define MX21_INT_GPT2 (NR_IRQS_LEGACY + 25) 109#define MX21_INT_GPT1 (NR_IRQS_LEGACY + 26) 110#define MX21_INT_WDOG (NR_IRQS_LEGACY + 27) 111#define MX21_INT_PCMCIA (NR_IRQS_LEGACY + 28) 112#define MX21_INT_NFC (NR_IRQS_LEGACY + 29) 113#define MX21_INT_BMI (NR_IRQS_LEGACY + 30) 114#define MX21_INT_CSI (NR_IRQS_LEGACY + 31) 115#define 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MX21_DMA_REQ_CSPI1_RX 18 162#define MX21_DMA_REQ_CSPI1_TX 19 163#define MX21_DMA_REQ_UART4_RX 20 164#define MX21_DMA_REQ_UART4_TX 21 165#define MX21_DMA_REQ_UART3_RX 22 166#define MX21_DMA_REQ_UART3_TX 23 167#define MX21_DMA_REQ_UART2_RX 24 168#define MX21_DMA_REQ_UART2_TX 25 169#define MX21_DMA_REQ_UART1_RX 26 170#define MX21_DMA_REQ_UART1_TX 27 171#define MX21_DMA_REQ_BMI_TX 28 172#define MX21_DMA_REQ_BMI_RX 29 173#define MX21_DMA_REQ_CSI_STAT 30 174#define MX21_DMA_REQ_CSI_RX 31 175 176#endif /* ifndef __MACH_MX21_H__ */ 177