1/* SPDX-License-Identifier: GPL-2.0-or-later */ 2/* 3 * Copyright 2004-2007 Freescale Semiconductor, Inc. All Rights Reserved. 4 * Copyright 2008 Juergen Beisert, kernel@pengutronix.de 5 * 6 * This contains i.MX27-specific hardware definitions. For those 7 * hardware pieces that are common between i.MX21 and i.MX27, have a 8 * look at mx2x.h. 9 */ 10 11#ifndef __MACH_MX27_H__ 12#define __MACH_MX27_H__ 13 14#define MX27_AIPI_BASE_ADDR 0x10000000 15#define MX27_AIPI_SIZE SZ_1M 16#define MX27_DMA_BASE_ADDR (MX27_AIPI_BASE_ADDR + 0x01000) 17#define MX27_WDOG_BASE_ADDR (MX27_AIPI_BASE_ADDR + 0x02000) 18#define MX27_GPT1_BASE_ADDR (MX27_AIPI_BASE_ADDR + 0x03000) 19#define MX27_GPT2_BASE_ADDR (MX27_AIPI_BASE_ADDR + 0x04000) 20#define MX27_GPT3_BASE_ADDR (MX27_AIPI_BASE_ADDR + 0x05000) 21#define MX27_PWM_BASE_ADDR (MX27_AIPI_BASE_ADDR + 0x06000) 22#define MX27_RTC_BASE_ADDR (MX27_AIPI_BASE_ADDR + 0x07000) 23#define MX27_KPP_BASE_ADDR (MX27_AIPI_BASE_ADDR + 0x08000) 24#define MX27_OWIRE_BASE_ADDR (MX27_AIPI_BASE_ADDR + 0x09000) 25#define MX27_UART1_BASE_ADDR (MX27_AIPI_BASE_ADDR + 0x0a000) 26#define MX27_UART2_BASE_ADDR (MX27_AIPI_BASE_ADDR + 0x0b000) 27#define MX27_UART3_BASE_ADDR (MX27_AIPI_BASE_ADDR + 0x0c000) 28#define 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11) 130#define MX27_INT_I2C1 (NR_IRQS_LEGACY + 12) 131#define MX27_INT_SSI2 (NR_IRQS_LEGACY + 13) 132#define MX27_INT_SSI1 (NR_IRQS_LEGACY + 14) 133#define MX27_INT_CSPI2 (NR_IRQS_LEGACY + 15) 134#define MX27_INT_CSPI1 (NR_IRQS_LEGACY + 16) 135#define MX27_INT_UART4 (NR_IRQS_LEGACY + 17) 136#define MX27_INT_UART3 (NR_IRQS_LEGACY + 18) 137#define MX27_INT_UART2 (NR_IRQS_LEGACY + 19) 138#define MX27_INT_UART1 (NR_IRQS_LEGACY + 20) 139#define MX27_INT_KPP (NR_IRQS_LEGACY + 21) 140#define MX27_INT_RTC (NR_IRQS_LEGACY + 22) 141#define MX27_INT_PWM (NR_IRQS_LEGACY + 23) 142#define MX27_INT_GPT3 (NR_IRQS_LEGACY + 24) 143#define MX27_INT_GPT2 (NR_IRQS_LEGACY + 25) 144#define MX27_INT_GPT1 (NR_IRQS_LEGACY + 26) 145#define MX27_INT_WDOG (NR_IRQS_LEGACY + 27) 146#define MX27_INT_PCMCIA (NR_IRQS_LEGACY + 28) 147#define MX27_INT_NFC (NR_IRQS_LEGACY + 29) 148#define MX27_INT_ATA (NR_IRQS_LEGACY + 30) 149#define MX27_INT_CSI (NR_IRQS_LEGACY + 31) 150#define MX27_INT_DMACH0 (NR_IRQS_LEGACY + 32) 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MX27_DMA_REQ_SSI1_RX1 14 197#define MX27_DMA_REQ_SSI1_TX1 15 198#define MX27_DMA_REQ_CSPI2_RX 16 199#define MX27_DMA_REQ_CSPI2_TX 17 200#define MX27_DMA_REQ_CSPI1_RX 18 201#define MX27_DMA_REQ_CSPI1_TX 19 202#define MX27_DMA_REQ_UART4_RX 20 203#define MX27_DMA_REQ_UART4_TX 21 204#define MX27_DMA_REQ_UART3_RX 22 205#define MX27_DMA_REQ_UART3_TX 23 206#define MX27_DMA_REQ_UART2_RX 24 207#define MX27_DMA_REQ_UART2_TX 25 208#define MX27_DMA_REQ_UART1_RX 26 209#define MX27_DMA_REQ_UART1_TX 27 210#define MX27_DMA_REQ_ATA_TX 28 211#define MX27_DMA_REQ_ATA_RCV 29 212#define MX27_DMA_REQ_CSI_STAT 30 213#define MX27_DMA_REQ_CSI_RX 31 214#define MX27_DMA_REQ_UART5_TX 32 215#define MX27_DMA_REQ_UART5_RX 33 216#define MX27_DMA_REQ_UART6_TX 34 217#define MX27_DMA_REQ_UART6_RX 35 218#define MX27_DMA_REQ_SDHC3 36 219#define MX27_DMA_REQ_NFC 37 220 221#endif /* ifndef __MACH_MX27_H__ */ 222