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7#ifndef __ASM_ARCH_HARDWARE_H
8#define __ASM_ARCH_HARDWARE_H
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10#define REGBASE 0x01c00000
11#define REGL(addr) (*(volatile unsigned int *)(REGBASE+addr))
12#define REGW(addr) (*(volatile unsigned short *)(REGBASE+addr))
13#define REGB(addr) (*(volatile unsigned char *)(REGBASE+addr))
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20#define SYSCFG REGL(0x000000)
21#define NCACHBE0 REGL(0x000004)
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29#define BWSCON REGL(0x080000)
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101#define PCOND REGL(0x12001c)
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177#define ALMMON REGB(0x170064)
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179#define RTCRST REGB(0x17006c)
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181#define BCDMIN REGB(0x170074)
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202#define INTCON REGL(0x200000)
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206#define I_PSLV REGL(0x200010)
207#define I_PMST REGL(0x200014)
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221#define LCDSADDR1 REGL(0x300008)
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227#define DP1_2 REGL(0x300020)
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229#define DP3_5 REGL(0x300028)
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235#define LCDCON3 REGL(0x300040)
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275#define CLEAR_PEND_INT(n) I_ISPC = (1<<(n))
276#define INT_ENABLE(n) INTMSK &= ~(1<<(n))
277#define INT_DISABLE(n) INTMSK |= (1<<(n))
278
279#define HARD_RESET_NOW()
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281#endif
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