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9#ifndef _SUNXI_GPIO_H
10#define _SUNXI_GPIO_H
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12#include <linux/types.h>
13#include <asm/arch/cpu.h>
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22#define SUNXI_GPIO_A 0
23#define SUNXI_GPIO_B 1
24#define SUNXI_GPIO_C 2
25#define SUNXI_GPIO_D 3
26#define SUNXI_GPIO_E 4
27#define SUNXI_GPIO_F 5
28#define SUNXI_GPIO_G 6
29#define SUNXI_GPIO_H 7
30#define SUNXI_GPIO_I 8
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37#define SUNXI_GPIO_BANKS 9
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52#define SUNXI_GPIO_L 11
53#define SUNXI_GPIO_M 12
54#define SUNXI_GPIO_N 13
55
56struct sunxi_gpio {
57 u32 cfg[4];
58 u32 dat;
59 u32 drv[2];
60 u32 pull[2];
61};
62
63
64struct sunxi_gpio_int {
65 u32 cfg[3];
66 u32 ctl;
67 u32 sta;
68 u32 deb;
69};
70
71struct sunxi_gpio_reg {
72 struct sunxi_gpio gpio_bank[SUNXI_GPIO_BANKS];
73 u8 res[0xbc];
74 struct sunxi_gpio_int gpio_int;
75};
76
77#define BANK_TO_GPIO(bank) (((bank) < SUNXI_GPIO_L) ? \
78 &((struct sunxi_gpio_reg *)SUNXI_PIO_BASE)->gpio_bank[bank] : \
79 &((struct sunxi_gpio_reg *)SUNXI_R_PIO_BASE)->gpio_bank[(bank) - SUNXI_GPIO_L])
80
81#define GPIO_BANK(pin) ((pin) >> 5)
82#define GPIO_NUM(pin) ((pin) & 0x1f)
83
84#define GPIO_CFG_INDEX(pin) (((pin) & 0x1f) >> 3)
85#define GPIO_CFG_OFFSET(pin) ((((pin) & 0x1f) & 0x7) << 2)
86
87#define GPIO_DRV_INDEX(pin) (((pin) & 0x1f) >> 4)
88#define GPIO_DRV_OFFSET(pin) ((((pin) & 0x1f) & 0xf) << 1)
89
90#define GPIO_PULL_INDEX(pin) (((pin) & 0x1f) >> 4)
91#define GPIO_PULL_OFFSET(pin) ((((pin) & 0x1f) & 0xf) << 1)
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94#define SUNXI_GPIO_A_NR 32
95#define SUNXI_GPIO_B_NR 32
96#define SUNXI_GPIO_C_NR 32
97#define SUNXI_GPIO_D_NR 32
98#define SUNXI_GPIO_E_NR 32
99#define SUNXI_GPIO_F_NR 32
100#define SUNXI_GPIO_G_NR 32
101#define SUNXI_GPIO_H_NR 32
102#define SUNXI_GPIO_I_NR 32
103#define SUNXI_GPIO_L_NR 32
104#define SUNXI_GPIO_M_NR 32
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106#define SUNXI_GPIO_NEXT(__gpio) \
107 ((__gpio##_START) + (__gpio##_NR) + 0)
108
109enum sunxi_gpio_number {
110 SUNXI_GPIO_A_START = 0,
111 SUNXI_GPIO_B_START = SUNXI_GPIO_NEXT(SUNXI_GPIO_A),
112 SUNXI_GPIO_C_START = SUNXI_GPIO_NEXT(SUNXI_GPIO_B),
113 SUNXI_GPIO_D_START = SUNXI_GPIO_NEXT(SUNXI_GPIO_C),
114 SUNXI_GPIO_E_START = SUNXI_GPIO_NEXT(SUNXI_GPIO_D),
115 SUNXI_GPIO_F_START = SUNXI_GPIO_NEXT(SUNXI_GPIO_E),
116 SUNXI_GPIO_G_START = SUNXI_GPIO_NEXT(SUNXI_GPIO_F),
117 SUNXI_GPIO_H_START = SUNXI_GPIO_NEXT(SUNXI_GPIO_G),
118 SUNXI_GPIO_I_START = SUNXI_GPIO_NEXT(SUNXI_GPIO_H),
119 SUNXI_GPIO_L_START = 352,
120 SUNXI_GPIO_M_START = SUNXI_GPIO_NEXT(SUNXI_GPIO_L),
121 SUNXI_GPIO_N_START = SUNXI_GPIO_NEXT(SUNXI_GPIO_M),
122 SUNXI_GPIO_AXP0_START = 1024,
123};
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126#define SUNXI_GPA(_nr) (SUNXI_GPIO_A_START + (_nr))
127#define SUNXI_GPB(_nr) (SUNXI_GPIO_B_START + (_nr))
128#define SUNXI_GPC(_nr) (SUNXI_GPIO_C_START + (_nr))
129#define SUNXI_GPD(_nr) (SUNXI_GPIO_D_START + (_nr))
130#define SUNXI_GPE(_nr) (SUNXI_GPIO_E_START + (_nr))
131#define SUNXI_GPF(_nr) (SUNXI_GPIO_F_START + (_nr))
132#define SUNXI_GPG(_nr) (SUNXI_GPIO_G_START + (_nr))
133#define SUNXI_GPH(_nr) (SUNXI_GPIO_H_START + (_nr))
134#define SUNXI_GPI(_nr) (SUNXI_GPIO_I_START + (_nr))
135#define SUNXI_GPL(_nr) (SUNXI_GPIO_L_START + (_nr))
136#define SUNXI_GPM(_nr) (SUNXI_GPIO_M_START + (_nr))
137#define SUNXI_GPN(_nr) (SUNXI_GPIO_N_START + (_nr))
138
139#define SUNXI_GPAXP0(_nr) (SUNXI_GPIO_AXP0_START + (_nr))
140
141
142#define SUNXI_GPIO_INPUT 0
143#define SUNXI_GPIO_OUTPUT 1
144#define SUNXI_GPIO_DISABLE 7
145
146#define SUNXI_GPA_EMAC 2
147#define SUN6I_GPA_GMAC 2
148#define SUN7I_GPA_GMAC 5
149#define SUN6I_GPA_SDC2 5
150#define SUN6I_GPA_SDC3 4
151#define SUN8I_H3_GPA_UART0 2
152
153#define SUN4I_GPB_PWM 2
154#define SUN4I_GPB_TWI0 2
155#define SUN4I_GPB_TWI1 2
156#define SUN5I_GPB_TWI1 2
157#define SUN4I_GPB_TWI2 2
158#define SUN5I_GPB_TWI2 2
159#define SUN4I_GPB_UART0 2
160#define SUN5I_GPB_UART0 2
161#define SUN8I_GPB_UART2 2
162#define SUN8I_A33_GPB_UART0 3
163#define SUN8I_A83T_GPB_UART0 2
164#define SUN50I_GPB_UART0 4
165
166#define SUNXI_GPC_NAND 2
167#define SUNXI_GPC_SPI0 3
168#define SUNXI_GPC_SDC2 3
169#define SUN6I_GPC_SDC3 4
170#define SUN50I_GPC_SPI0 4
171
172#define SUN8I_GPD_SDC1 3
173#define SUNXI_GPD_LCD0 2
174#define SUNXI_GPD_LVDS0 3
175
176#define SUN5I_GPE_SDC2 3
177#define SUN8I_GPE_TWI2 3
178
179#define SUNXI_GPF_SDC0 2
180#define SUNXI_GPF_UART0 4
181#define SUN8I_GPF_UART0 3
182
183#define SUN4I_GPG_SDC1 4
184#define SUN5I_GPG_SDC1 2
185#define SUN6I_GPG_SDC1 2
186#define SUN8I_GPG_SDC1 2
187#define SUN6I_GPG_TWI3 2
188#define SUN5I_GPG_UART1 4
189
190#define SUN6I_GPH_PWM 2
191#define SUN8I_GPH_PWM 2
192#define SUN4I_GPH_SDC1 5
193#define SUN6I_GPH_TWI0 2
194#define SUN8I_GPH_TWI0 2
195#define SUN6I_GPH_TWI1 2
196#define SUN8I_GPH_TWI1 2
197#define SUN6I_GPH_TWI2 2
198#define SUN6I_GPH_UART0 2
199#define SUN9I_GPH_UART0 2
200
201#define SUNXI_GPI_SDC3 2
202#define SUN7I_GPI_TWI3 3
203#define SUN7I_GPI_TWI4 3
204
205#define SUN6I_GPL0_R_P2WI_SCK 3
206#define SUN6I_GPL1_R_P2WI_SDA 3
207
208#define SUN8I_GPL_R_RSB 2
209#define SUN8I_H3_GPL_R_TWI 2
210#define SUN8I_A23_GPL_R_TWI 3
211#define SUN8I_GPL_R_UART 2
212
213#define SUN9I_GPN_R_RSB 3
214
215
216#define SUNXI_GPIO_PULL_DISABLE 0
217#define SUNXI_GPIO_PULL_UP 1
218#define SUNXI_GPIO_PULL_DOWN 2
219
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221#define SUNXI_GPIO_AXP0_PREFIX "AXP0-"
222#define SUNXI_GPIO_AXP0_VBUS_DETECT 4
223#define SUNXI_GPIO_AXP0_VBUS_ENABLE 5
224#define SUNXI_GPIO_AXP0_GPIO_COUNT 6
225
226void sunxi_gpio_set_cfgbank(struct sunxi_gpio *pio, int bank_offset, u32 val);
227void sunxi_gpio_set_cfgpin(u32 pin, u32 val);
228int sunxi_gpio_get_cfgbank(struct sunxi_gpio *pio, int bank_offset);
229int sunxi_gpio_get_cfgpin(u32 pin);
230int sunxi_gpio_set_drv(u32 pin, u32 val);
231int sunxi_gpio_set_pull(u32 pin, u32 val);
232int sunxi_name_to_gpio_bank(const char *name);
233int sunxi_name_to_gpio(const char *name);
234#define name_to_gpio(name) sunxi_name_to_gpio(name)
235
236#if !defined CONFIG_SPL_BUILD && defined CONFIG_AXP_GPIO
237int axp_gpio_init(void);
238#else
239static inline int axp_gpio_init(void) { return 0; }
240#endif
241
242#endif
243
